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山東省青島市黃島區(qū)?
| ?應(yīng)屆畢業(yè)生?| ?本科?
| ?年齡不限? | ?招6~10人? | ?校招
法定節(jié)假日 雙休8小時工作制
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專業(yè)要求
電子科學(xué)與技術(shù)
電子信息工程
電子信息科學(xué)與技術(shù)
不限
薪資詳情
發(fā)放方式：每月15日?????
崗位職責(zé)
1.承擔(dān)芯片項目 SOC 系統(tǒng)級設(shè)計、集成設(shè)計、頂層和 IO 設(shè)計，拉通芯片各 CBB 及端到端實(shí)現(xiàn)流程。
2.開發(fā) FPGA 原型平臺系統(tǒng)，支持芯片項目的 SoC 設(shè)計驗(yàn)證及 CBB 設(shè)計驗(yàn)證。
3.負(fù)責(zé)數(shù)字模塊開發(fā)與交付，包括需求規(guī)格分解、方案設(shè)計、代碼實(shí)現(xiàn)、仿真驗(yàn)證、 SYN / STA 等端到端設(shè)計流程。
崗位要求
1.熟悉 Verilog 語言、 SOC 體系架構(gòu)、典型電路設(shè)計、具備數(shù)字邏輯開發(fā)經(jīng)驗(yàn)。
2.或者熟練掌握 FPGA 邏輯設(shè)計方法，熟悉 FPGA 硬件特點(diǎn)，掌握 FPGA 版本設(shè)計， FPGA 問題定位方法。
3.質(zhì)量意識好，善于溝通交流與合作。
4.2026屆畢業(yè)生。
工作地址
山東省青島市黃島區(qū)·海信靈山國際
HR信息
林經(jīng)理
3日內(nèi)活躍
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