1．教學(xué)/科研
2.系統(tǒng)掌握FPGA結(jié)構(gòu)資源、FPGA設(shè)計(jì)流程和FPGA設(shè)計(jì)工具；
3.掌握Verilog HDL語(yǔ)言的高級(jí)編碼，充分理解時(shí)序分析理論及低功耗設(shè)計(jì)理論，掌握FPGA常用IP模塊工程開(kāi)發(fā)中的應(yīng)用；
4.熟練掌握使用FPGA進(jìn)行語(yǔ)音、振動(dòng)等信號(hào)及圖像的信號(hào)處理算法的原理、結(jié)構(gòu)、方法和流程。
5.熟練掌握機(jī)器學(xué)習(xí)、模式識(shí)別、深度學(xué)習(xí)算法的設(shè)計(jì)研發(fā)流程及實(shí)現(xiàn)方法；
6.具有較強(qiáng)的編程能力：C/C 、Java、 Python，了解Matlab；
7.具有語(yǔ)音以及振動(dòng)信號(hào)模式識(shí)別經(jīng)驗(yàn)者優(yōu)先。
電子類、通信類、信號(hào)處理、計(jì)算機(jī)相關(guān)專業(yè)博士，具有工作經(jīng)驗(yàn)或動(dòng)手能力特別強(qiáng)的碩士可議。
在求職過(guò)程中如果遇到扣押證件、收取押金、提供擔(dān)保、強(qiáng)迫入股集資、解凍資金、詐騙傳銷、求職歧視、黑中介、人身攻擊、惡意騷擾、惡意營(yíng)銷、虛假宣傳或其他違法違規(guī)行為。請(qǐng)及時(shí)保留證據(jù)，立即向平臺(tái)舉報(bào)投訴，必要時(shí)可以報(bào)警、起訴，維護(hù)自己的合法權(quán)益。
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